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100BaseT4 이더넷 송수신기를 위한 타이밍 복원 회로의 설계 = Timing recovery circuit design for 100BaseT4 ethernet transceiverlink 이준석; Lee, Joon-Suk; et al, 한국과학기술원, 1997 |
IEEE 802.15.4 2.4GHz 물리 계층을 위한 디지털 기저대역 프로세서 설계 = Digital baseband processor design for IEEE 802.15.4 2.4GHz PHY layerlink 박석종; Park, Seok-Jong; et al, 한국과학기술원, 2003 |
Jitter-reduced digital symbol timing recovery for 16-CAP VDSL system = 16-CAP VDSL시스템에 알맞은 지터를 줄인 디지털 심볼 타이밍 복원link Song, Yong-Chul; 송용철; et al, 한국과학기술원, 1999 |
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