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1
Code generation algorithms for dual data memory banks of digital signal processors = 디지털 신호 처리기의 듀얼 데이터 메모리 뱅크를 위한 코드 생성 알고리즘link

Cho, Jeong-Hun; 조정훈; et al, 한국과학기술원, 2003

2
Storage offset assignment for execution time improvement in digital signal processor = 디지털 신호 처리기에서 실행시간 개선을 위한 스토리지 위치 할당link

Park, Dae-Jin; 박대진; et al, 한국과학기술원, 2003

3
Temporal partitioning to amortize reconfiguration overhead for dynamically reconfigurable architectures = 동적 재구성 아키텍처의 재구성 오버헤드를 줄이기 위한 시간적 분할 기법link

Kim, Jin-Hwan; 김진환; et al, 한국과학기술원, 2008

4
VLIW 구조를 가진 상업용 network processor에 대한 코드 생성 = Compiling for a commercial VLIW network processorlink

김진환; Kim, Jin-Hwan; et al, 한국과학기술원, 2002

5
디지털 신호 처리기를 위한 Register class가 적용된 very portable optimizer = The very portable optimizer for digital signal processors with register classlink

정성준; Jung, Sung-Joon; et al, 한국과학기술원, 2002

6
소프트웨어 수행시간의 정적 추정에 관한 연구 = A study on the static estimation of software execution timelink

이종열; Lee, Jong-Yeol; et al, 한국과학기술원, 1996

7
아키텍처 기술 언어를 통한 DSP를 위한 retargetable compiler의 구현 = Retargetable compiler for DSP using architecture description languagelink

오세종; Oh, Se-Jong; et al, 한국과학기술원, 2002

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